Serial Lite IV Intel® FPGA IP Core
El núcleo de propiedad intelectual (PI) de Serial Lite IV Intel FPGA es adecuado para la comunicación de datos de gran ancho de banda para aplicaciones chip a chip, placa a placa y backplane.
Serial Lite IV Intel® FPGA IP Core
El núcleo de IP de Serial Lite IV incorpora un control de acceso a medios (MAC), una subcapa de codificación física (PCS) y un bloque de fijación de medios físicos (PMA). La IP es compatible con transferencias de datos de hasta 58 Gbps por carril con un máximo de 12 carriles PAM4 de los transceptores de uso general en F-tile (FGT) de Intel® Agilex™ y hasta 116 Gbps, con un máximo de 4 carriles PAM4 de los transceptores de alta velocidad en F-tile (FHT) de Intel® Agilex™ en un solo vínculo; o 28 Gbps por carril con un máximo de 16 carriles de no retorno a cero (NRZ) de FGT y 58 Gbps por carril con un máximo de 4 carriles de NRZ de FHT. Este protocolo ofrece un gran ancho de banda, pocas tramas de sobrecarga, bajo recuento de E/S y es compatible con una gran escalabilidad tanto en el número de carriles como en la velocidad. La IP es fácilmente reconfigurable y es compatible con una amplia gama de velocidades de datos con el modo Ethernet PCS del transceptor E-Tile y el transceptor F-Tile.
Esta IP es compatible con dos modos de transmisión:
- Modo básico: se trata de un modo de transmisión puro en el que los datos se envían sin el inicio del paquete, el ciclo vacío y el final del paquete para aumentar el ancho de banda. La IP toma el primer dato válido como inicio de una ráfaga.
- Modo completo: Este es el modo de paquete de transferencia de datos. Se envía una ráfaga y un ciclo de sincronización al principio y al final de un paquete como delimitadores.
Funciones
Característica | Descripción |
---|---|
Transferencia de datos |
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PC |
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Detección y manejo de errores |
|
Interfaces |
|
Estado de IP
Estado de pedido | Producción |
Códigos de pedido | |
Transmisión Serial Lite III FPGA IP Intel® |
IP-SLITE4 |
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