Núcleo Viterbi Intel® FPGA IP

El núcleo Viterbi Intel FPGA IP genera funciones de propiedad intelectual (IP) Viterbi de alto rendimiento y decisión flexible que implementan una amplia gama de decodificadores Viterbi estándar.

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Núcleo Viterbi Intel® FPGA IP

La decodificación Viterbi (también conocida como decodificación de máxima probabilidad o programación dinámica de avance) es la forma más habitual de decodificar códigos convolucionales utilizando una técnica de decodificación asintóticamente óptima. En su forma básica, la decodificación Viterbi es un algoritmo eficiente y recursivo que realiza una búsqueda exhaustiva óptima. Normalmente, se utilizan un codificador convolucional y un decodificador Viterbi juntos para proporcionar corrección de errores en canales con ruido. Por ejemplo, en canales de comunicaciones.

Características

Las características del núcleo Viterbi Intel FPGA IP incluyen:

  • Arquitectura paralela de alta velocidad con
  • Rendimiento de más de 240 Mbps
  • Funcionamiento completamente paralelo
  • Decodificación de bloques mejorada y decodificación continua
  • Arquitectura híbrida de baja a media velocidad
  • Número configurable de unidades de adición, comparación y selección (ACS)
  • Arquitectura basada en memoria
  • Amplia gama de prestaciones y área lógica
  • Decodificador Viterbi completamente parametrizado, que incluye:
  • Número de bits codificados
  • Longitud de limitación
  • Número de bits suaves
  • Longitud de rastro
  • Polinomio por cada bit codificado
  • Longitud de limitación variable
  • Compatibilidad con la modulación
  • Opción de modulación codificada Trellis (TCM)
  • Simulación y verificación
  • Bancos de prueba VHDL para verificar el decodificador
  • Modelos de simulación funcional de propiedad intelectual (IP) para su uso en simuladores VHDL y Verilog HDL compatibles con Intel FPGA
  • Interfaces y herramientas
  • Interfaces de transmisión Avalon®
  • DSP Builder para FPGA Intel

Recursos adicionales

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I-Tested

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